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2017年03月15日
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uCySsoXZ
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書き込んだスレッド一覧
arisa ◆QaHT6HayjI
【Verilog】 記述言語で論理設計Project14 【VHDL】 [無断転載禁止]©2ch.net
トランジスタ技術のスレ [無断転載禁止]©2ch.net
書き込みレス一覧
【Verilog】 記述言語で論理設計Project14 【VHDL】 [無断転載禁止]©2ch.net
743 ：
arisa
◆QaHT6HayjI
[sage]：2017/03/15(水) 09:45:44.12 ID:uCySsoXZ
>>742
その程度のレベルだと問題おきない。
あと、君の態度が悪い。くそうぜー氏ね
【Verilog】 記述言語で論理設計Project14 【VHDL】 [無断転載禁止]©2ch.net
744 ：
arisa
◆QaHT6HayjI
[sage]：2017/03/15(水) 09:47:02.92 ID:uCySsoXZ
verilogの冒頭と末尾に default_nettypeを入れるのがくそうぜー
【Verilog】 記述言語で論理設計Project14 【VHDL】 [無断転載禁止]©2ch.net
745 ：
arisa
◆QaHT6HayjI
[sage]：2017/03/15(水) 09:53:51.24 ID:uCySsoXZ
>>742
そもそも、そのコードは符号付き演算じゃないだろ。オマエバカか？
トランジスタ技術のスレ [無断転載禁止]©2ch.net
496 ：
arisa
◆QaHT6HayjI
[sage]：2017/03/15(水) 16:13:59.23 ID:uCySsoXZ
>>495
メガネ率は？
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